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Vivado 是赛灵思(Xilinx)公司推出的一款综合性的设计工具套件,用于 FPGA(现场可编程门阵列)和 SoC(系统级芯片)的设计、开发和验证。它提供了一系列功能强大的工具,帮助工程师在各种应用领域中实现高性能、低功耗的硬件设计。
项目开发中常用的Vivado软件调试技巧(三)
在ILA核中,通常使用通过添加Marker线观察信号长度,如图1所示。如果删除Marker线,选中要删除的线然后右键,选择Delete Marker
把 Vivado 项目放心交给 Git:一篇 FPGA 工程师必读的实战指南
之前分享过一篇文章《FPGA 版本管理三种方式:你会选哪一种?》,评论区很多人都推荐使用Git进行版本管理,今天这篇文章主题就是使用Git进行备份指南。
项目开发中常用的Vivado软件调试技巧(一)
在项目中,利用JTAG采样低频数据时,受限于片上BRAM资源,采样的数据深度不能太深;另外,通常会受限于JTAG仿真器时钟也不能设置太低频率
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