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RISC-V

RISC-V是一种基于精简指令集计算机(RISC)架构的开源指令集架构(ISA)。与其他商业架构(如ARM或x86)不同,RISC-V是由加州大学伯克利分校的学术界和行业合作伙伴开发的,它是一种开放、免费的指令集架构,具有可扩展性和灵活性。

RISC-V的设计目标是提供一种简洁、灵活且可扩展的架构,使其能够适应各种不同的应用场景,从微控制器到超级计算机等。RISC-V架构采用了模块化设计的理念,定义了基本的指令集,并允许用户根据自己的需求添加自定义指令集扩展(ISA扩展),从而实现对特定应用的优化。

由于其开放的特性,RISC-V架构在学术界和工业界都受到了广泛的关注和采用。它已经成为了各种不同领域的研究和开发的重要工具,如嵌入式系统、物联网、人工智能、边缘计算等。很多公司和组织都开始采用RISC-V架构设计自己的处理器芯片或者开发板,以满足不同领域的需求。

总的来说,RISC-V作为一种开放、免费的指令集架构,具有可扩展性、灵活性和通用性,已经成为了计算机体系结构领域的重要创新,并在全球范围内得到了广泛的应用和推广。

合见工软携双方案亮相玄铁RISC-V生态大会 共筑RISC-V高性能验证新范式

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2026“开放・连接” 玄铁RISC-V生态大会在上海盛大启幕,中国数字 EDA/IP 龙头企业上海合见工业软件集团股份有限公司(简称 “合见工软”)作为核心合作伙伴重磅出席,与达摩院玄铁联合发布两大技术成果

【原创】隼瞻科技的RISC-V版图:从处理器IP到EDA平台的“矩阵化突围”

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在RISC-V发展大潮中,中国本土企业正在重新定义“处理器设计”的边界。从单一IP授权,到架构共创、再到软硬协同,生态的重心正从“核”向“系统”迁移,而隼瞻科技正是这场变革中的代表性力量。

赛昉科技联合合见工软实现国产一致性NoC IP与RISC-V核在大规模网络中的适配

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中国数字EDA/IP龙头企业上海合见工业软件集团有限公司(简称“合见工软”)与中国RISC-V软硬件生态领导者赛昉科技共同宣布双方的突破性技术合作成果。


开芯院采用芯华章P2E硬件验证平台加速RISC-V 验证

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近日,系统级验证 EDA 解决方案提供商芯华章科技与北京开源芯片研究院宣布,双方基于芯华章的P2E 硬件验证系统双模验证平台,共同探索适用于 RISC-V 架构的高效验证方法学,基于开芯院昆明湖四核设计,预期实现倍数级的效率提升,

【原创】从EDA基石到IP:新思科技要成为RISC-V时代的“生态基建者”

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在AI加速、异构计算与SoC集成高度融合的时代背景下,RISC-V作为一个“可定制、可扩展、开放”的新兴指令集架构,正在逐步从“技术实验室”走向“规模化商业落地”。

亚科鸿禹荣获RISC-V生态“EDA贡献奖”,领域创新获权威认可!

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2025年2月28日,中国RISC-V生态大会--中国开放指令生态(RISC-V)联盟2024年会 生态成果颁奖仪式 在北京举行。亚科鸿禹凭借自主研发的RISC-V软硬件集成开发调试创新EDA平台--HyperVenus,获颁年度“EDA贡献奖”